maruCc(TM)シリーズ第6弾
CELICA 登場!!

・ シリーズ初、Dual FPGA搭載
・ ユーザーのあらゆる要望にこたえる豊富な分岐命令。
・ 外部割込み機能搭載。
・ 7セグメントLEDによる、わかりやすいインターフェイス。
・ ナイトライダー命令を標準装備。


製品仕様 オプション 命令一覧 設計製作工数 開発者コメント

製品仕様 【CELICA】

設計方式 3段パイプラインRISC
命令形式 2アドレスロードストア方式16ビット命令
レジスタ数 8ビット汎用レジスタ 4個
算術論理演算回路 8ビットALU 1個
内部バス 8ビット 3系統
外部バス 16ビット命令バス, 8ビットデータバスの2系統
(ハーバードアーキテクチャ)
主記憶 256×2バイト(命令メモリ)+256バイト(データメモリ)
CPU動作可能
最高周波数
28.571MHz(推定)
FPGA Xilinx 4010PG191 (400中241CLBを使用)
Xilinx 4010PG191 (400中15CLBを使用)
周辺TTL数 29個(74シリーズ)
入出力 トグルスイッチ22個, LED10個, 7セグメントLED1個
アプリケーション ユークリッドの互除法, ナイトライダー

オプション

【SS-I】 CELICA専用アセンブラ
yacc/lex によるCELICA専用アセンブラ。任意のプログラムカウンター値に対応。10進数、16進数による入力が可能。ただし、ラベルには対応していません。
動作環境:Indy。

命令一覧

略記号 アドレスモード 命令機能
HLT 00 00 HaLT
LD {reg} {mem} LoaD
ST {reg} {mem} STore
CPY {reg} {reg} CoPY
ADD {reg} {reg} ADD
ADI {reg} {imm} ADd Immediate
SUB {reg} {reg} SUBtract
SBI {reg} {imm} SuBtract Immediate
CMP {reg} {reg} CoMPare
CPI {reg} {imm} ComPare Immediate
SLL {reg} 00 Shift Left Logically
SRL {reg} 00 Shift Right Logically
BA 00 {imm} Branch Always
BV 00 {imm} Branch on oVerflow
BZ 00 {imm} Branch on Zero
BNZ 00 {imm} Branch on Not Zero
BN 00 {imm} Branch on Negative
BZP 00 {imm} Branch on Zero or Positive
BP 00 {imm} Branch on Positive
BZN 00 {imm} Branch on Zero or Negative
BC 00 {imm} Branch on Carry
BNC 00 {imm} Branch on Not Carry
BGE 00 {imm} Branch on Greater than or Equal
BGT 00 {imm} Branch on Greater Than
BLE 00 {imm} Branch on Less than or Equal
BLT 00 {imm} Branch on Less Than

設計製作工数

システム分析/設計 2週
CAD 7週
ボードの設計 3週
デバッグ 4週
稼働日 平成10年7月3日 (ボード)
平成10年8月4日 (CPU)

開発者コメント

基板の作成まで、すごい順調だったのだが、DMAが終わってからのデバッグにすごい時間がかかったのが悔しい。当初の予定では、いまだ完成とは言えないが、実験の課題はクリアしているので、よしとしようと思う。
夏休みに突入した事も、過去を振り返った時のいい笑い話になるだろうし。

開発:上野友宏 ・ 協力:河野陽一




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